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Aufnahme Datum 2024-06-05

Kurs-Verknüpfung

CPU Entwurf mit VHDL

Lehrende(r)

Philipp Holzinger

Zugang

IdM-Anmeldung

Sprache

Deutsch

Einrichtung

Lehrstuhl für Informatik 3 (Rechnerarchitektur)

Produzent

Lehrstuhl für Informatik 3 (Rechnerarchitektur)

Format

Vorlesung

Typ

universitäre Vorlesung

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